上海優(yōu)勢數(shù)模轉換器怎么樣

逐次逼近型ADC：逐次逼近型ADC是另一種直接ADC，它也產(chǎn)生一系列比較電壓VR，但與并聯(lián)比較型ADC不同，它是逐個產(chǎn)生比較電壓，逐次與輸入電壓分別比較，以逐漸逼近的方式進行模數(shù)轉換的。逐次逼近型ADC每次轉換都要逐位比較，需要（n+1）個節(jié)拍脈沖才能完成，所以它比并聯(lián)比較型ADC的轉換速度慢，比雙分積型ADC要快得多，屬于中速ADC器件。另外位數(shù)多時，它需用的元器件比并聯(lián)比較型少得多，所以它是集成ADC中，應用較廣的一種 [5]。雙積分型ADC：屬于間接型ADC，它先對輸入采樣電壓和基準電壓進行兩次積分，以獲得與采樣電壓平均值成正比的時間間隔，同時在這個時間間隔內(nèi)，用計數(shù)器對標準時鐘脈沖（CP）計數(shù)，計數(shù)器輸出的計數(shù)結果就是對應的數(shù)字量。雙積分型ADC優(yōu)點是抗干擾能力強；穩(wěn)定性好；可實現(xiàn)高精度模數(shù)轉換。主要缺點是轉換速度低，因此這種轉換器大多應用于要求精度較高而轉換速度要求不高的儀器儀表中，例如用于多位高精度數(shù)字直流電壓表中 [5]。這樣就要求定義一個參數(shù)來表示新的數(shù)字信號采樣自模擬信號速率。上海優(yōu)勢數(shù)模轉換器怎么樣

失調誤差失調誤差(或稱零點誤差)定義為數(shù)字輸入全為0碼時，其模擬輸出值與理想輸出值之偏差值。對于單極性D/A轉換，模擬輸出的理想值為零伏點。對于雙極性D/A轉換，理想值為負域滿量程。偏差值的大小一般用LSB的份數(shù)或用偏差值相對滿量程的百分數(shù)來表示。增益誤差D/A轉換器的輸入與輸出傳遞特性曲線的斜率稱為D/A轉換增益或標度系數(shù)，實際轉換的增益與理想增益之間的偏差稱為增益誤差(或稱標度誤差)。增益誤差在消除失調誤差后用滿碼。虹口區(qū)質量數(shù)模轉換器怎么樣它由若干個相同的R、2R網(wǎng)絡節(jié)組成，每節(jié)對應于一個輸入位。節(jié)與節(jié)之間串接成倒T形網(wǎng)絡。

N比特電阻分壓型DAC需要2N個電阻，電流舵DAC則需要2N-1個電流單元。電阻分壓型數(shù)模轉換器利用電阻對基準電壓VREF分壓產(chǎn)生1LSB的電壓，I LSB=VREF/2N，電流舵DAC由單位電流IO流過電阻負載RL產(chǎn)生的壓降IO*RL產(chǎn)生1LSB的電壓，所以電流舵DAC中的IO和位數(shù)以及RL的大小決定了VouT的幅度，VouT=(2N- I ) *RL*IO 。很明顯，圖5的兩種數(shù)模轉換器的輸出電壓特性均為單調性的。兩種數(shù)模轉換器的微分非線性誤差(DNL)均由單個器件的精度所決定，所以DNL會比較小，假設單元電流IO的標準偏差(Standard Deviation)為σ(I)，則DNL大小為σ(I)/IO，而INL和流到RL上的單元電流個數(shù)n有關，INL大小為n1/2* σ(I)/IO

混疊所有的模擬數(shù)字轉換器以每隔一定時間進行采樣的形式進行工作。因此，它們的輸出信號只是對輸入信號行為的不完全描述。在某一次采樣和下一次采樣之間的時間段，**根據(jù)輸出信號，是無法得知輸入信號的形式的。如果輸入信號以比采樣率低的速率變化，那么可以假定這兩次采樣之間的信號介于這兩次采樣得到的信號值。然而，如果輸入信號改變過快，則這樣的假設是錯誤的。如果模擬數(shù)字轉換器產(chǎn)生的信號在系統(tǒng)的后期，通過數(shù)字模擬轉換器，則輸出信號可以忠實地反映原始信號。如經(jīng)過輸入信號的變化率比采樣率大得多，則是另一種情況，模擬數(shù)字轉換器輸出的這種“假”信號被稱作“混疊”?；殳B信號的頻率為信號頻率和采樣率的差。例如，一個2千赫茲的正弦曲線信號在采樣率在1.5千赫茲采樣率的轉換后，會被重建為500赫茲的正弦曲線信號。這樣的問題被稱作“混疊”。儀表促進了更快的ADC速度和更多的通道數(shù)與密度，設計者必須評估轉換器的輸出格式，以及基本的轉換性能。

二進制權重圖6是5比特二進制權重的數(shù)模轉換器的實現(xiàn)方式，總共只有5個二進制編碼的電流單元，即后一個電流大小是前一個的兩倍，5比特二進制輸入直接控制5個開關，用以確定流到負載RL的電流大小，形成模擬電壓輸出Vout。此方式實現(xiàn)的數(shù)模轉換器控制非常簡單，N比特數(shù)字輸入碼直接依次加在二進制加權電流單元開關上，不需要任何的譯碼動作。為了達到比較好的版圖匹配，n*IO電流單元由n個單獨的IO單元來實現(xiàn)。二進制加權數(shù)模轉換器的缺點就是DNL 比較差，理論上來講，**差的DNL發(fā)生在MSB(Most significant Bit)的轉換:DAC主要由數(shù)字寄存器、模擬電子開關、位權網(wǎng)絡、求和運算放大器和基準電壓源（或恒流源）組成。閔行區(qū)通用數(shù)模轉換器推薦貨源

和權電阻網(wǎng)絡比較，由于它只有R、2R兩種阻值，從而克服了權電阻阻值多，且阻值差別大的缺點 [1]。上海優(yōu)勢數(shù)模轉換器怎么樣

間接ADC是先將輸入模擬電壓轉換成時間或頻率，然后再把這些中間量轉換成數(shù)字量，常用的有中間量是時間的雙積分型ADC [5]。并聯(lián)比較型ADC：由于并聯(lián)比較型ADC采用各量級同時并行比較，各位輸出碼也是同時并行產(chǎn)生，所以轉換速度快是它的突出優(yōu)點，同時轉換速度與輸出碼位的多少無關。并聯(lián)比較型ADC的缺點是成本高、功耗大。因為n位輸出的ADC，需要2n個電阻，（2n－1）個比較器和D觸發(fā)器，以及復雜的編碼網(wǎng)絡，其元件數(shù)量隨位數(shù)的增加，以幾何級數(shù)上升。所以這種ADC適用于要求高速、低分辯率的場合 [5]。上海優(yōu)勢數(shù)模轉換器怎么樣

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